배터리 랙과 PCS 사이, 인터페이스가 갈리는 두 지점
초록 — 배터리 랙과 PCS는 케이블 한 가닥으로 연결되는 것처럼 보이지만, 전력선과 통신선 두 개의 인터페이스가 동시에 맞아야 시스템이 올라온다. 전력 쪽에서는 랙 직렬 셀 수 변경이 DC 전압창의 상한과 하한을 동시에 이동시켜, 한쪽만 확인하면 저SOC 구간에서 PCS가 기동하지 않는다. 통신 쪽에서는 레지스터 맵과 스케일 팩터가 표준화 범위 밖에 남아 있어, 단위 불일치 하나가 SOC를 10배로 읽히게 만든다. 아래 수치는 설명을 위한 가정값이며 실제 셀·PCS 사양으로 재계산해야 한다.
1. 결론부터 — 두 인터페이스는 각각 검토하면 반드시 놓친다
랙-PCS 인터페이스에서 발생하는 커미셔닝 지연은 대부분 “한쪽만 검토했다”에서 나온다. 전력 설계자는 전압창을, 제어 설계자는 프로토콜을 각각 확인하지만, 두 검토가 같은 문서에서 만나지 않으면 설계 변경이 한쪽에만 반영된다.

상황(Situation)은 랙 사양과 PCS 사양이 각각 확정된 상태다. 복잡성(Complication)은 랙 사양 변경이 전력과 통신 양쪽에 동시에 파급된다는 점이다. 질문(Question)은 “어떤 변경이 어느 쪽에 파급되는가”이며, 답(Answer)은 변경 항목별로 두 인터페이스를 모두 대조하는 체크리스트를 고정 항목으로 두는 것이다.
2. 전력 인터페이스 — DC 버스 전압창은 양단이 함께 움직인다
랙의 DC 전압은 SOC에 따라 변동하며, 그 전 범위가 PCS 입력 전압창 안에 들어와야 한다. 가정 조건으로 LFP 셀을 240 직렬로 구성한 경우를 계산한다.
| 항목 | 240 직렬 | 256 직렬 |
|---|---|---|
| 셀 전압 하한 2.5 V | 600 V | 640 V |
| 셀 공칭 3.2 V | 768 V | 819 V |
| 셀 전압 상한 3.65 V | 876 V | 934 V |
| PCS 입력 허용 600~1,000 V | 충족 | 충족 |
| PCS 기동 최소 640 V | 미달 (600 V) | 충족 (640 V) |
240 직렬 구성은 PCS의 허용 입력 범위 600~1,000 V를 만족하지만, 기동 최소 전압 640 V는 저SOC 구간에서 충족하지 못한다. 정상 운전 중에는 문제가 드러나지 않다가, 심방전 후 재기동 시점에 PCS가 올라오지 않는 형태로 나타난다.
256 직렬로 바꾸면 하한이 640 V로 올라와 기동 조건을 만족한다. 다만 상한도 876 V에서 934 V로 함께 올라가므로, 상한 여유가 66 V로 줄어든다는 점을 같이 확인해야 한다. 직렬 셀 수는 전압창의 한쪽 끝이 아니라 양단을 동시에 밀어 올린다.
3. 통신 인터페이스 — 표준화가 끝나는 지점은 레지스터 맵이다
| 구분 | 주요 방식 | 흔한 이슈 |
|---|---|---|
| 물리 계층 | CAN, RS-485 | 종단저항 누락, 배선 길이 초과 |
| 프로토콜 | CANopen, Modbus RTU/TCP | 레지스터 맵 버전 불일치 |
| 데이터 | SOC / SOH / 셀 전압 | 단위·스케일 팩터 오독 |
물리 계층과 프로토콜은 표준으로 정의되지만, 어느 주소에 무엇이 어떤 배율로 들어가는지는 벤더 구현에 남는다. 즉 “같은 Modbus를 쓴다”는 사실은 인터페이스 정합의 근거가 되지 못한다.
4. 스케일 팩터 오독이 만드는 결과 — 계산 예
BMS가 SOC를 0.1% 단위 정수(0~1000)로 송신하고 PCS가 1% 단위(0~100)로 해석하는 경우를 가정한다.
| 실제 SOC | BMS 송신값 | PCS 해석 | PCS 동작 |
|---|---|---|---|
| 45.0% | 450 | 450% → 100% 클램프 | 만충 판단, 충전 차단 |
| 12.0% | 120 | 120% → 100% 클램프 | 만충 판단, 방전 계속 |
| 8.0% | 80 | 80% | 정상 해석 (우연한 일치) |
주목할 점은 SOC 10.0% 미만 구간에서만 값이 우연히 일치한다는 것이다. 커미셔닝을 저SOC 상태에서 시작하면 통신이 정상으로 보이고, 충전이 진행되어 SOC가 10%를 넘는 순간부터 PCS가 계속 만충으로 판단한다. 단일 시점 확인으로는 스케일 오류를 잡을 수 없다.
따라서 검증은 최소 2점, 가급적 저·중·고 SOC 3점에서 실측값과 PCS 표시값을 대조하는 방식이어야 한다. 위 사례는 가정 시나리오이며, 실제 시스템에서 이 형태의 오류가 어떤 빈도로 발생하는지는 별도 검토가 필요하다.
5. 검토 시점이 공수를 가른다
같은 불일치라도 발견 시점에 따라 대응 공수가 크게 달라진다. 설계 단계에서 전압창을 재계산하는 일은 문서 작업이지만, 커미셔닝 단계에서 같은 문제를 만나면 랙 재구성 또는 PCS 교체가 필요해진다.
이 차이는 설계 변경 체크리스트에 고정 항목을 두는 것만으로 상당 부분 흡수된다. 랙 직렬 셀 수, 셀 모델, BMS 펌웨어 버전 세 항목은 변경될 때마다 전력·통신 양쪽 검토를 트리거하도록 묶어 두는 것이 실무적이다.
FAQ
Q. 표준 프로토콜(CANopen 등)만 쓰면 이런 문제가 없나?
물리 계층과 상위 프로토콜이 표준화되어도 레지스터 맵과 스케일 팩터는 벤더 구현에 남는 경우가 많다. 표준 채택은 물리·전송 계층의 확인 항목을 줄여 줄 뿐, 데이터 계층의 대조 작업을 없애지 못한다.
Q. PCS 입력 허용 범위만 만족하면 되는 것 아닌가?
허용 입력 범위(operating range)와 기동 최소 전압(start-up threshold)은 별개 사양이다. 위 계산에서 240 직렬은 허용 범위 600~1,000 V를 만족하면서도 기동 최소 640 V를 만족하지 못한다. 두 값을 같은 항목으로 다루면 심방전 후 재기동 불가 문제가 커미셔닝에서 처음 드러난다.
현장 적용 노트
| 단계 | 할 일 | 산출물 |
|---|---|---|
| 1 | 랙 직렬 셀 수 × 셀 전압 상·하한으로 DC 전압창 양단을 재계산 | 전압창 표 |
| 2 | PCS 사양서에서 허용 입력 범위와 기동 최소 전압을 따로 발췌 | PCS 임계값 2종 |
| 3 | 전압창 하한이 기동 최소를 넘는지, 상한 여유가 몇 V인지 확인 | 여유 V 값 |
| 4 | BMS·PCS 레지스터 맵 대조표를 벤더 양측 서면으로 확정 | 서명된 대조표 |
| 5 | 저·중·고 SOC 3점에서 실측값과 PCS 표시값 교차 검증 | 스케일 검증 기록 |
| 6 | 직렬 셀 수·셀 모델·BMS 펌웨어를 설계 변경 체크리스트 고정 항목으로 등록 | 갱신된 체크리스트 |
1~3단계는 사양서만으로 당일 완료 가능하다. 5단계는 충전 설비가 필요하므로 커미셔닝 일정에 별도 항목으로 반영해 두어야 하며, 저SOC 1점만 확인하고 넘어가면 앞서 본 우연한 일치에 걸린다.
측정·산정 조건
셀 전압 2.5 / 3.2 / 3.65 V, 직렬 240·256, PCS 허용 입력 600~1,000 V, 기동 최소 640 V, SOC 스케일 0.1% 단위는 모두 설명을 위해 설정한 가정값이며 특정 제품의 사양이 아니다. 전압 계산은 셀 내부 저항에 의한 부하 시 전압 강하와 온도에 따른 전압 특성 변화를 반영하지 않은 무부하 기준값이다. 실제 설계에서는 최대 방전 전류 조건에서의 전압 강하와 저온(0 °C 이하) 특성을 함께 대입해 하한을 재확인해야 한다.
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